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SMD振荡器如何改善EMC-EMI

来源:http://dgkjly.com 作者:帝国科技 2024年01月04
每个产品设计师每天都要处理电磁兼容性(EMC)或电磁干扰(EMI)的问题,特别是在使用石英晶体振荡器等频率决定元件时。安装在石英振荡器中的集成电路产生陡峭、锋利的侧边,并产生强烈的谐波泛音。扩频振荡器是解决这个问题的一种方法,但在许多应用中它们不能被使用。例如,当中心扩展为±0.5%时,输出频率在4±0.5%的范围内调制。给定频率为33.333或66.666 MHz,频率调制为±0.5%意味着频率调制范围为33.333 MHz±166.665 kHz或66.666 MHz±333.330 kHz -对于精确时钟来说太大了。这些应用通常只允许±50ppm,或者换句话说,少100倍。±50 ppm的频率稳定性相当于在33.333 MHz时的±1.66665 kHz公差,或在66.666 MHz时的±3.3333 kHz公差。在这种情况下,开发商迄今不得不采取非常昂贵的措施来降低EMC - EMI。这已经没有必要了。基于创新的IC技术-下一代时钟- Landsberg am Lech的Petermann-Technik提供高度多样化的SMD硅时钟振荡器,具有SoftLevel输出信号。软电平技术是一种可编程输出信号,其中LVCMOS输出信号的谐波泛音可以通过延长上升时间(trise)和下降时间(tfall)来显着降低。软电平技术允许精确调整输出信号,以满足各自的客户要求。
SoftLevel函数的作用
 
图1显示了上升和下降幅度在20%到80%之间的LVCMOS输出信号的周期t。图2显示了在电源电压为+3.3 VDC时,正常LVCMOS方波信号(红线)与SoftLevel LVCMOS输出信号(蓝线)的侧面轮廓。该图表清楚地显示了SoftLevel函数如何使方波的边缘圆化(产生类似鲨鱼鳍的形状),从而显着减少谐波泛音。图3显示了与输出信号周期t相关的EMC - EMI衰减(奇谐波泛音)。Trise和tfall与时钟信号的周期t成比例表示。
trise和tfall可以在t的0.05到0.45(5%到45%)范围内延长。如果trise和tfall与基信号相比延长5%,则信号形状非常接近原始方波信号。当延长至45%时,输出信号的形状越来越像鱼翅,在第11次谐波处,EMC - EMI衰减大于- 60 dB。如此简单的升降调整价值巨大。
 
SoftLevel功能的成本是多少?没有,因为SoftLevel功能是LPO, LPOP, HTLPO, WTLPO, UPO, HTLPO- aut和WTLPO- aut系列的SMD晶振的标准功能。(AUT = AEC-Q100中定义的汽车)。这些振荡器系列还提供标准外壳尺寸为7 mm x 5 mm, 5 mm x 3.2 mm, 3.2 mm x 2.5 mm, 2.5 mm x 2.0 mm和2.0 mm x 1.6 mm,因此可以放置在现有的PCB布局上,作为石英振荡器的直接替代品。因此,PETERMANN-TECHNIK的内部工程可以根据应用程序的具体需求为客户提供最佳建议并编程产品,开发人员必须准确地说出他在应用程序中可以接受的上升/下降时间。正是这种编程-延长升/降-实现谐波泛音衰减。在SMD硅时钟振荡器电路设计中,Petermann-Technik的专家建议在电源电压和接地引脚之间使用0.1 μF的去耦电容。这大大减少了电源电压的影响。
 
SMD硅时钟振荡器的其他优点
上述系列的SMD硅时钟振荡器也可用于2.25至3.63 VDC的电源电压范围。振荡器可以由该VDD范围内的任何电源电压驱动(例如2.5 VDC±10%,2.8 VDC±10%,3.0 VDC±10%或3.3 VDC±10%)。因此,产品开发人员只需要为四个经典电源电压限定一个振荡器。这一标准特性为开发人员节省了大量用于组件鉴定的资金,也为供应链经理节省了大量用于采购、管理和存储数量显著减少的组件的资金。大量购买的部件价格较低。当然,SoftLevel功能也可以在2.25 ~ 3.63 VDC的VDD范围内作为标准特性使用。作为另一个标准功能,SMD硅时钟振荡器具有非常严格的频率公差,例如±20 ppm @?40/85°C,±30 ppm @?40/105°C和±50 ppm @?40/125°C。当然,aec - q100兼容的振荡器(HTLPO-AUT和WTLPO-AUT)也具有上述所有功能。
SoftLevel功能改善了EMC - EMI特性
PETERMANN晶振公司的SMD硅时钟振荡器的EMC - EMI特性可以通过使用SoftLevel功能简单地调整输出信号的上升和下降而显著改善,这意味着开发人员不再需要采取昂贵的措施来改善其应用程序的EMC - EMI性能。SMD硅时钟振荡器可以直接放置在现有的PCB布局上。此外,由于VDD范围为2.25至3.63 VDC,并且标准频率公差非常严格,因此可以在组件认证,采购,管理和存储方面节省大量资金。

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